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Research sábado, 25 de julio de 2026, 21:36

DAC 2026: Microsoft Artour Levin presenta cuellos de botella EDA a escala de acelerador de IA; los límites hardware-software se vuelven el punto de dolor

The Design Automation Conference 2026 (26-29 de julio, Long Beach) está previsualizando un cambio en la metodología EDA (automatización de diseño electrónico) impulsado por la complejidad del acelerador de IA. Artour Levin de Microsoft, VP de Ingeniería de Silício de IA, entregará una charla magistral el miércoles titulada 'EDA Opportunities in Building High Performance AI Accelerators', enmarcando el problema central: a medida que los aceleradores se escalan de chips a sistemas completos, los problemas difíciles emergen cada vez más en límites—entre cómputo, memoria, interconexión y comportamiento de software—exactamente donde los silos EDA tradicionales no fueron diseñados para operar.

La pista de Ingeniería de la conferencia abarca 15 sesiones con ~90 presentaciones revisadas por pares sobre lo que funcionó y se rompió en silício de 2026. Las charlas notables incluyen a Lalitha Immaneni de Intel sobre integración heterogénea, Huiming Bu de IBM Research sobre evolución de proceso de 7nm a 7Å, y Baaziz Achour de Qualcomm EVP sobre 'Design Automation for Emerging AI: From AI Chips to Data Center.' Además, la sesión del martes 'AI-Accelerated IP Libraries' destaca cómo el diseño de célula estándar en sí ahora está usando ML: el dimensionamiento de transistor impulsado por IA genera mejoras de 2x en potencia y cronograma en silício industrial real mientras mantiene compatibilidad con flujos EDA heredados.

Para arquitectos: DAC 2026 señala que la optimización de herramientas puntuales (lo que hace EDA tradicional) ha golpeado retornos decrecientes para silício de IA. La siguiente frontera es verificación a nivel de sistema holística y co-simulación—uniendo lógica, memoria, interconexión, potencia, térmica, embalaje y software en un bucle de diseño unificado. Este es un cambio de múltiples años en cómo las organizaciones de diseño de chips se personalizan y la selección de herramientas.

Fuentes

Primary source
eetimes.com
“The interesting question is not whether AI helps chip design but whether it works within today's tool silos or forces a holistic rethink.”